pin giao

T

triump.ar

Guest
làm thế nào để làm pin giao cho virtex 4 fpga ... im không nhận được chỉ định làm thế nào để chân ...

 
Các người hỏi làm thế nào để chọn I / O pins khi thiết kế phần cứng máy tính bảng của bạn, hoặc làm thế nào để xác định pin ISE số trong dự án của bạn?

Nếu ISE, sau đó bạn có nhiều cách khác nhau của quy định cụ thể các chân phụ thuộc vào dòng chảy công việc bạn đã chọn.Hãy thử bắt đầu với phần "Giao Pin Địa điểm hạn chế" trong Quick của bạn "ISE" Hướng dẫn Start, qst.pdf.Xem thêm "Lộc" trong "ISE của bạn" chế cgd.pdf, Hướng dẫn.

 
tôi muốn biết làm thế nào để gán các chân để thiết kế HDL của tôi ...

 
Nếu bạn đang sử dụng Xilinx Navigator dự án công cụ tổng hợp, sử dụng tùy chọn chỉ định các gói pin cho theo Tiêu đề hạn chế người sử dụng.
Cùng một kỹ thuật sử dụng đối với các công cụ khác.
Nhưng đừng quên rằng u nên cũng có thể có hướng dẫn sử dụng đặc tả kỹ thuật cho FPGA.

 
Có hai cách để làm điều này.
1.Văn bản pin dựa ép quy định tại UCF (Thành viên hạn chế file)
bạn có thể tham khảo Xilinx tài liệu về các định dạng
2.Sử dụng tiện ích PACE (Pinout và khu vực hạn chế Editor) trong Xilinx ISE. Mà đơn giản hoá việc giao pin bằng cách sử dụng giao diện của nó và sẽ chăm sóc của tạo UCF.

 

Welcome to EDABoard.com

Sponsor

Back
Top